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正点原子FPGA 今日: 1 |主题: 4233|排名: 38 

版主: QinQZ, dongguo100
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悬赏 预览 [其他]imx6ULL裸机实验,程序烧录到TF卡 新人帖 qiaobangzhu121 2021-2-11 210600 QinQZ 2022-6-6 10:53
悬赏 预览 [XILINX]Dynamic Clock设置为480*272模式下无法正确输出时钟 新人帖 attach_img ganyunhan 2022-6-3 15344 QinQZ 2022-6-6 10:50
已解决 预览 [其他]达芬奇开发板DDR3实验添加MIG IP核失败 attach_img a614922411 2022-5-14 34037 a614922411 2022-6-4 20:06
预览 [ALTERA]开拓者开发板oscp示波器实验界面异常,有人出现过吗? 新人帖 attach_img fuyunliushuizjf 2022-6-2 45762 QinQZ 2022-6-2 16:52
悬赏 预览 [XILINX]低功耗、高抗干扰VK2C23A/B 点阵式存储映射 56SEGx4COM LCD液晶驱动IC attach_img 果芒DB 2022-6-1 05172 果芒DB 2022-6-1 14:43
已解决 预览 [XILINX]Artix-7核心板硬件设计相关技术支持 新人帖 KooLee 2022-5-22 25309 KooLee 2022-6-1 14:21
已解决 预览 [ALTERA]ModelSim手动仿真出现这个错误 attach_img 头发 2022-5-31 44626 A571157242 2022-6-1 09:39
悬赏 预览 [XILINX]vavido2020.2仿真simulation过一会就闪退 QMSTAR 2022-5-28 13923 QinQZ 2022-6-1 09:29
悬赏 预览 [其他]FPGA达芬奇Pro DDR3读写问题 新人帖 attach_img 18187151461 2022-5-31 45970 arm51avr 2022-6-1 08:10
已解决 预览 [ALTERA]这个编译警告怎么解决 Quartus 18.0 头发 2022-5-28 33796 头发 2022-5-31 20:48
悬赏 预览 [ALTERA]modelsim仿真运行但是一直没有数据 attach_img 刘王村 2020-10-16 411229 myth1218 2022-5-30 00:21
悬赏 预览 [ALTERA]FPGA AD采集矩形波 出现的波形不理想 attach_img lidada111 2022-5-26 25635 Percy123 2022-5-28 20:37
预览 [XILINX]Petalinux版本升级到最新版本如何实现? 新人帖 fwp728 2022-5-25 12983 QinQZ 2022-5-25 14:00
悬赏 预览 [XILINX]神通过大的网友们,谁有Model Composer的license呀? hawkgreen 2022-5-16 26140 arm51avr 2022-5-22 13:37
已解决 预览 [XILINX]PL写入BRAM数据地址错位问题 attach_img youzhisan 2022-5-3 26049 youzhisan 2022-5-22 00:28
已解决 预览 [XILINX]Zynq AXI GPIO中断裸机与ILA调试问题 youzhisan 2022-4-16 36692 youzhisan 2022-5-22 00:27
悬赏 预览 [XILINX]关于摄像头调试OV5640显示输出问题, ayong 2022-5-21 15728 QinQZ 2022-5-21 15:02
悬赏 预览 [XILINX]用ZYNQ实现车牌识别,大伙有什么思路吗 CJC529 2022-5-19 14576 正点原子 2022-5-21 01:18
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悬赏 预览 [ALTERA]quartus prime lite edition问题 opsd999 2022-5-17 14198 正点原子 2022-5-18 22:00
已解决 预览 [XILINX]MIG操作的DDR与PS操作的DDR在物理上是不是同一个DDR芯片? 281638360 2022-5-16 15163 arm51avr 2022-5-17 19:38
预览 [ALTERA]基于FPGA的SD卡的VGA显示图片实验 新人帖 外文 2021-3-28 49014 学习者a 2022-5-17 14:27
已解决 预览 [XILINX]请问AXIGPIO如何既做输入也做输出? attach_img 13703224964 2022-5-16 25152 正点原子 2022-5-17 01:36
已解决 预览 [XILINX]AXI总线上IO口的中断求助,设置输出位会直接进入中断 attach_img dai410257573 2022-5-11 65680 arm51avr 2022-5-16 21:42
已解决 预览 [ALTERA]Verilog测量输入信号脉宽的方法 attach_img 15125413637 2020-7-1 1011468 jshzp 2022-5-16 08:56
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悬赏 预览 [XILINX]想实现DVI视频信号的采集核存储,特来求助大佬 kaka001 2022-5-7 55972 QinQZ 2022-5-11 09:21
悬赏 预览 [XILINX]请教一下,有没有开源的图像处理ISP ayong 2022-4-12 36275 ayong 2022-5-10 17:34
已解决 预览 [XILINX]vivado给zynq下载程序只能使用xilinx的仿真器么,用普通的ARM j-Link行不行 新人帖 kdl123456 2022-4-18 66603 QinQZ 2022-5-9 14:30
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