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LVDS设计，不用IP核，纯Verilog编写串行器、解串器等配置，有人做过没？

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发表于 2017-8-28 10:42:59 | 显示全部楼层 |阅读模式

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LVDS设计，不用IP核，纯Verilog编写串行器、解串器等配置，有人做过没？

正点原子逻辑分析仪DL16劲爆上市

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