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如何设计一个程序测试脉冲信号的上升时间

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发表于 2016-7-27 21:32:50 | 显示全部楼层 |阅读模式
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测量范围是55~999ns,测量误差不大于5%。
参加TI杯竞赛
各位大哥速度给个建议啊。

正点原子逻辑分析仪DL16劲爆上市
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发表于 2016-7-28 14:54:43 | 显示全部楼层
定时器的输入捕捉功能
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发表于 2016-7-28 14:55:35 | 显示全部楼层
捕获啊
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发表于 2016-7-29 17:49:14 | 显示全部楼层
脉冲信号的上升时间,并不是高电平持续时间。
我个人觉得应该有2个思路:
1、ADC+中断+TIM定时器
2、硬件上用2个运放(电压比较),输出到2个普通IO口,用TIM记录两个IO外部中断间隔时间。
个人初步想法,请指教。
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发表于 2016-7-29 20:12:05 | 显示全部楼层
得知道信号电平比较好做一些。
信号上升沿,是多少V到多少V,然后设计2个运放,分别放大两个节点(最低电压(低电平最大的值),最高电压(高电平最低的值)),输入给STM32,这样就统计这两个节点的时间差即可。
我是开源电子网www.openedv.com站长,有关站务问题请与我联系。
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