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stm32f103c8t6的五六脚应该接多大的晶振?

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发表于 2015-3-31 12:08:43 | 显示全部楼层 |阅读模式
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我看到有的接12M的,应该就是固定12M吧

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查看完整内容[请看2#楼]

回复【3楼】闪电之舞: --------------------------------- 系统时钟(SYSCLK)有3个来源,内部高速8M时钟(HSI),PLL时钟和外部高速时钟(5 6脚接的HSE),而PLL时钟又有2个来源,即内部高速时钟2分频(HSI/2=4M)和外部高速时钟(HSE) 通常,SYSCLK常用PLL倍频而来,当SYSCLK=72M,外部(5 6脚)接8M晶振,经过9倍频即为72M,如果外部使用12M,那只需要6倍频即可得到72M  SYSCLK, 具体的细节请参考STM32参考手册 ...
正点原子逻辑分析仪DL16劲爆上市
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发表于 2015-3-31 12:08:44 | 显示全部楼层
回复【3楼】闪电之舞:
---------------------------------
系统时钟(SYSCLK)有3个来源,内部高速8M时钟(HSI),PLL时钟和外部高速时钟(5 6脚接的HSE),而PLL时钟又有2个来源,即内部高速时钟2分频(HSI/2=4M)和外部高速时钟(HSE)
通常,SYSCLK常用PLL倍频而来,当SYSCLK=72M,外部(5 6脚)接8M晶振,经过9倍频即为72M,如果外部使用12M,那只需要6倍频即可得到72M  SYSCLK,
具体的细节请参考STM32参考手册6.2节(那个时钟树很清晰明了)
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发表于 2015-3-31 12:45:39 | 显示全部楼层
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 楼主| 发表于 2015-3-31 13:13:18 | 显示全部楼层
回复【2楼】会飞的咸鱼:
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都是一样的吗,没影响吗?
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