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[XILINX] MMCM_adv_ClkFrequency_div_no_dclk

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发表于 2025-5-25 21:43:30 | 显示全部楼层 |阅读模式

正点原子逻辑分析仪DL16热卖中，最多16通道，采样率最高可达1GHz，存储深度可达3.5Gbit

当使用Vivado 时，点击implement之后出现如下图所示的报错的时候（如图1所示）
应该考虑时钟约束的过程中时钟大小、时钟引脚、时钟名称等是否设置错误，如下图2所示

图片1

图片2

正点原子逻辑分析仪DL16劲爆上市

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