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[XILINX] 达芬奇pro中ddr3原理图问题

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发表于 2025-5-2 05:47:50 | 显示全部楼层 |阅读模式
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为什么原理图中ddr3芯片用到了A0-A14共15根地址线,而所给例程中只输出了14根地址线?第15根地址线一定要接地吗?为什么达芬奇的原理图中第15根地址线没接地?
屏幕截图 2025-05-02 053809.png

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原理图是做了兼容的设计,理论上可以支持更大内存的DDR3
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发表于 2025-5-2 05:47:51 | 显示全部楼层
原理图是做了兼容的设计,理论上可以支持更大内存的DDR3
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