FPGA DDR写数据，app_rdy很规律拉低

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代码用到是DFZU2EG_4EV MPSoc中的例程，我在仿真DDR4写数据,遇到隔376或者384个地址，APP_rdy拉低很长一段时间，很规律。程序是正点原子的代码，在这上面的基础上改的，区别是保存128个字节。