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[XILINX] AXI4读写关于AXI_BVALID的疑问

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发表于 2024-10-14 11:13:11 | 显示全部楼层 |阅读模式

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AXI写完数据响应数据这么晚才来是什么原因这样岂不是很影响读写效率

QQ截图20241014111116.jpg

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你发起写，并不是接收端采集完就完事了，写的数据最终要写入DDR的，我推测可能是写入到DDR才给出写响应的，具体可以再研究研究

正点原子逻辑分析仪DL16劲爆上市

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发表于 2024-10-14 11:13:12 | 显示全部楼层

正点原子ESP32 AI开发套件上市，python

你发起写，并不是接收端采集完就完事了，写的数据最终要写入DDR的，我推测可能是写入到DDR才给出写响应的，具体可以再研究研究

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