达芬奇microblaze的DDR读写实验

fuwa · 发表于 2023-8-6 09:33:16

1、第九章 AXI4接口之DDR读写实验，按照操作自己搭建block design，验证没问题。2、约束文件拷贝源码的约束。

3、生成比特流时提示错误：

fuwa · 发表于 2023-8-6 09:33:17

问题找到了，由于mig的输入时钟设置错了，应该是200M而不是400M，
错误如下：

把400M改为200M问题就解决了。

QinQZ · 发表于 2023-8-7 09:44:08

要看具体提示什么错误

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