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[国产FPGA] zynq如何封装axistream收发的ip核

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发表于 2023-4-14 09:38:47 | 显示全部楼层 |阅读模式
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大佬们,想要封装一个带有axistream收发接收的均值滤波ip核,和dma进行直连,官方示例的主从机代码,自己使用后,无法正确的输出。想请问是否有大佬有相关的文章或相关的封装经验,不胜感激!

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发表于 2023-4-17 18:11:13 | 显示全部楼层
没封装过这个接口,不过官方生成的AXI代码一般只包含接口协议的,怎么和你自己的代码对接,需要先比较熟悉接口协议才行
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