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[国产FPGA] DDS输出数据的周期是20ns，dac8830的spi时钟最大是25MHz，dds输出经过dac8830丢失数据吗？

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发表于 2023-3-9 23:16:37 | 显示全部楼层 |阅读模式

正点原子逻辑分析仪DL16热卖中，最多16通道，采样率最高可达1GHz，存储深度可达3.5Gbit

我用的FPGA芯片工作频率是50MHz，通过DDS产生50KHz的正弦波，dds在FPGA的每个时钟周期会输出一个正弦波的点，但是我用的DAC芯片是16bit的DAC8830，它是SPI接口，它的SPI最大速率是50MHz，但是为了稳定一般选用25MHz，这样的话SPI采集一个16bit的数据大概需要超过680ns的时间。
所以我用DAC8830将FPGA产生的正弦波数据转化为模拟量，是不是会丢失很多数据？那我应该怎么办呢？

正点原子逻辑分析仪DL16劲爆上市

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发表于 2023-3-10 09:16:03 | 显示全部楼层

正点原子ESP32 AI开发套件上市，python

FPGA的时钟频率可以降频，通过PLL或者分频代码实现

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楼主| 发表于 2023-3-10 09:46:25 | 显示全部楼层

QinQZ 发表于 2023-3-10 09:16
FPGA的时钟频率可以降频，通过PLL或者分频代码实现

FPGA降频率以后，会对输出的正弦波的频率有所影响吗？

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楼主| 发表于 2023-3-10 09:48:03 | 显示全部楼层

QinQZ 发表于 2023-3-10 09:16
FPGA的时钟频率可以降频，通过PLL或者分频代码实现

而且FPGA降频以后，DDS的时钟频率，还有频率控制字是不是也要重新计算？

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发表于 2023-3-14 18:01:00 | 显示全部楼层

你也可以对dds输出的点进行抽点，只要抽点后的速度小于你adc转化的速度就行，比如50抽1

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