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[国产FPGA] HDMI显示彩条例程的一个小问题及修改方案

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发表于 2023-2-6 10:54:05 | 显示全部楼层 |阅读模式
在HDMI显示彩条的例程中,使用了video_driver模块:

该模块使用的复位方式是同步复位:

而在本例程中,该模块使用的时钟是由PLL产生的75MHz时钟,在pll_rst信号的上升沿后,需要过一段时间才能产生稳定的时钟,并把pll_lock置高,这导致复位信号产生时video_driver模块还没有周期变化的时钟,因而复位操作无法将cnt_h和cnt_v置0,这两个寄存器将一直保持高阻态,无法随时钟正常计数。
修改方案:将同步复位改为异步复位

修改后实测可用。


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