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[ALTERA] 求一个altera的PWM IP核.v文件

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发表于 2022-7-20 16:45:40 | 显示全部楼层 |阅读模式
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有altera的类似于dsp中pwm生成器的ip核.v文件吗

正点原子逻辑分析仪DL16劲爆上市
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发表于 2022-7-21 09:14:17 | 显示全部楼层
你可以在IP核目录里找一下,搜不到就没有,一般PWM简单的电路自己写下就行了
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精华

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发表于 2022-7-23 14:06:29 | 显示全部楼层
Xilinx Vivado 中没有提供 PWM 功能模块 IP。

但 PWM 的代码实际上不就是一个计数器吗。
计数器最大值即为 PWM 周期,
再设置一个比较阈值就是占空比。

如果熟悉 AXI 总线操作,可以新建一个AXI-Lite IP,来配置周期和占空比阈值。
如果不熟悉AXI总线,直接多建几个AXI-GPIO,来传输32Bit配置常数。

第二种办法,可以在网上找找,CSDN、GitHub,应该资料很多。

如果时间富裕的话,自己尝试编写一下还是蛮好的。
对于FPGA工程师,随手写一个计数器就像C语言随手写一句printf()调试一样。
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