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[ALTERA] fpga里如何进行接收数组的合法性校验

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发表于 2021-2-25 14:59:50 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式
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FPGA才开始学,请教论坛里高手在FPGA里数组比较方法。原来在C51里数组是这样比较的
现在用FPGA实现同样的功能,代码该如何写?

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正点原子逻辑分析仪DL16劲爆上市
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发表于 2021-2-26 01:45:07 | 只看该作者
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发表于 2021-2-26 09:07:57 | 只看该作者
CRC校验算法吗
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 楼主| 发表于 2021-2-26 09:10:02 | 只看该作者

不是CRC校验,校验接收到的数组是否约定格式
always@(posedge clk or negedge rst_n)
begin
    if(rst_n == 1'b0)
             dat_state <= 0;//初始化时
         else if(rx_buf[0] != 2)      //如果帧首错误
             dat_state <= STX_err;
         else if(rx_buf[len+3 ] != crcH)  //如果校验高字节错误
             dat_state <= crc_err;
         else if(rx_buf[len+4 ] != crcL)  //如果校验低字节错误
             dat_state <= crc_err;
         else if(rx_buf[len+5] != 3)  //如果帧尾错误
             dat_state <= ETX_err;
    else
             dat_state <= no_err;
end

总感觉自己写的不对,不知该怎么写
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发表于 2021-2-26 09:13:38 | 只看该作者
jindizhiwa 发表于 2021-2-26 09:10
不是CRC校验,校验接收到的数组是否约定格式
always@(posedge clk or negedge rst_n)
begin

为啥不对,不确定的话可以仿真看看
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 楼主| 发表于 2021-2-26 09:39:25 | 只看该作者
图中划记号的地方怎么写代码?能给点思路吗?

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