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[ALTERA] fpga多时钟源的问题。

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发表于 2020-8-14 09:04:35 来自手机 | 显示全部楼层 |阅读模式
制作音频播放器。本来是想用。cpld  那是资源太少。感觉搞不定。所以只能用fpga。但是音频播放有两种时钟。这个我就不多说了。
fpga我刚学还不会。时钟源应该怎么做?
理论上用哪个管脚都可以,是不是?
还是用专用的引脚比较好一些。
用的芯片是。ep4ce6
我不知道。fpga ep4ce6   有没有?多个时钟输入管脚。
哪个师傅了解给指点一下。
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发表于 2020-8-14 15:24:23 | 显示全部楼层
本帖最后由 colinh 于 2020-8-14 15:26 编辑

基本思路:计算好需要的时钟,用pll做倍频,然后再分频,需要对外输出的话,找个IO口就ok了。
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 楼主| 发表于 2020-8-14 15:56:54 | 显示全部楼层
我的意思是说,用哪个引脚做时钟源的输入端是不是有专用引脚?  因为是两个时钟源。不知道ep4ce6有几个专用时钟引脚。
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发表于 2020-8-15 11:31:37 | 显示全部楼层
有好几个引脚是专用引脚。输入时钟最好走专用引脚,当然如果频率不高,走不走专用引脚都可以
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 楼主| 发表于 2020-8-17 20:52:09 | 显示全部楼层
谢谢  用那几个专用的
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