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[ALTERA] 如何测试多个波形的相位差?

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发表于 2019-12-4 15:34:24 | 显示全部楼层 |阅读模式
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需要测试多路信号,需要测得两信号的相位差以及相位关系(超前、滞后)。

正点原子逻辑分析仪DL16劲爆上市
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发表于 2019-12-4 17:21:23 | 显示全部楼层
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 楼主| 发表于 2019-12-4 17:23:34 | 显示全部楼层

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发表于 2019-12-4 17:30:12 | 显示全部楼层
FPGA也可以吧,读引脚电平计算时间这样子
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 楼主| 发表于 2019-12-4 19:27:29 | 显示全部楼层
要记录多组数据,需要求平均值最大值最小值。
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 楼主| 发表于 2019-12-4 19:28:19 | 显示全部楼层
login_FAE 发表于 2019-12-4 17:30
FPGA也可以吧,读引脚电平计算时间这样子

要记录多组数据,需要求平均值最大值最小值。
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发表于 2019-12-5 09:12:41 | 显示全部楼层
可以使用FFT的方法    解出指定信号频率的初相位及幅值
让我们的思维驾驭在电的速度之上!
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 楼主| 发表于 2019-12-5 11:41:09 | 显示全部楼层
DongInker 发表于 2019-12-5 09:12
可以使用FFT的方法    解出指定信号频率的初相位及幅值

我需要测的是伺服电机的编码器信号,共11路信号,需要测电机旋转一圈的数据,我设想的是记录这11路波形的边沿时间,采集完成后统一计算,由此产生了一个问题,边沿时间存储至RAM过程中(边沿时间为32位,RAM为8位,需要存四次),若两边沿相差时间小于RAM存储所需要的时间,可能会出现数据存储错乱。主要是纠结在这个地方。
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发表于 2019-12-5 13:46:00 | 显示全部楼层
sunzhifan 发表于 2019-12-5 11:41
我需要测的是伺服电机的编码器信号,共11路信号,需要测电机旋转一圈的数据,我设想的是记录这11路波形的 ...

片内RAM?为什么不设置成32位的呢
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 楼主| 发表于 2019-12-5 15:57:56 | 显示全部楼层
QinQZ 发表于 2019-12-5 13:46
片内RAM?为什么不设置成32位的呢

用的片外RAM,芯片是CPLD ( EPM570 )。
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发表于 2019-12-6 09:24:14 | 显示全部楼层
sunzhifan 发表于 2019-12-5 15:57
用的片外RAM,芯片是CPLD ( EPM570 )。

对编码器进行计数不用准确判断两个脉冲的相位差是多少,只需要判断出一个脉冲相对于另一个是超前还是滞后就可以了,这个很简单的,网上应该有一些Verilog编写编码器计数的例子可以参考。
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 楼主| 发表于 2019-12-7 16:32:47 | 显示全部楼层
QinQZ 发表于 2019-12-6 09:24
对编码器进行计数不用准确判断两个脉冲的相位差是多少,只需要判断出一个脉冲相对于另一个是超前还是滞后 ...

测编码器相位是必须要测的,只计数那就太简单了。
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