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[ALTERA] verilog的always时序逻辑语句中2个或多个并行的if else语句间是并行执行的还是顺序执行的呢?

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发表于 2019-9-12 09:22:19 | 显示全部楼层 |阅读模式
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本帖最后由 天山狐狸 于 2019-9-12 09:23 编辑

如题,verilog的always时序逻辑语句中多个并行的if语句间是并行执行的还是顺序执行的呢?

例如:下面的语句编译就报错,这么说的话时序逻辑always中
  1.   reg[9:0] count;

  2.   always@(posedge sys,negedge rst) begin
  3.     if(!rst)  count <=10'd0;
  4.     else      count <=count+1;
  5.    
  6.     if(count >= 1000) count <=0;
  7.   end
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是并行执行的。但是异步复位的写法,是需要判断复位的。不判断复位生成的应该都不是寄存器。你可以单独写一段尝试一下
正点原子逻辑分析仪DL16劲爆上市
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发表于 2019-9-12 09:22:20 | 显示全部楼层
是并行执行的。但是异步复位的写法,是需要判断复位的。不判断复位生成的应该都不是寄存器。你可以单独写一段尝试一下
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 楼主| 发表于 2019-9-12 09:54:50 | 显示全部楼层
我来顶顶一顶顶啊   ,,等待大神的降临
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发表于 2019-9-16 08:20:46 | 显示全部楼层
是你的代码语法有问题:
                                            always@(posedge sys,negedge rst)
中间没有逗号,应该是 or
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 楼主| 发表于 2019-9-16 08:57:31 | 显示全部楼层
SunML 发表于 2019-9-16 08:20
是你的代码语法有问题:
                                            always@(posedge sys,negedge rst) ...

版主你该进修一下了,,,

or是95版的写法吧,,逗号是2001版的写法,,都可以使用的。。。。
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 楼主| 发表于 2019-9-16 08:58:29 | 显示全部楼层
SunML 发表于 2019-9-16 08:20
是你的代码语法有问题:
                                            always@(posedge sys,negedge rst) ...

版主你该进修一下啦

or是95标准的写法,逗号是2001标准新增的,,2种写法都可以的
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 楼主| 发表于 2019-9-16 08:59:48 | 显示全部楼层
SunML 发表于 2019-9-16 08:20
是你的代码语法有问题:
                                            always@(posedge sys,negedge rst) ...

答非所问,,差评
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发表于 2019-9-16 13:59:57 | 显示全部楼层
天山狐狸 发表于 2019-9-16 08:57
版主你该进修一下了,,,

or是95版的写法吧,,逗号是2001版的写法,,都可以使用的。。。。

进修去了
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 楼主| 发表于 2019-9-16 15:29:54 | 显示全部楼层

说笑啦。。。。
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