硬件接口 I2C、SPI在数据读写时被中断打断，时序是否出错

liuxuefei11 · 发表于 2013-11-22 18:57:57

各位大侠，大家有没有注意到这类的问题，就是普通单片机、ARM单片机的I2C接口、SPI接口在读写数据的过程中被中断打断后，读写数据是否会受到中断的影响，从而使读写数据错误，欢迎高手辩解。

正点原子 · 发表于 2013-11-22 22:11:37

硬件SPI,没这个特殊要求.
硬件IIC就不知道了.

liuxuefei11 · 发表于 2013-11-22 22:29:37

回复【2楼】正点原子:
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原子兄，我个人感觉SPI与I2C都可能出现这样问题的，SPI硬件只要是能，在数据传送完前时钟是一直有效的，但是数据读写过程中被中断打断，SPI的时钟引脚的波形是不会变的，但是数据上的数据肯定会受到影响，因为处理中断时CPU并没有继续在读写数据，当然DMA来操作SPI读写要出除外。再说I2C吧，更是，根据I2C的时序特点，在中断的时间过长，主机无法接收到从机的应答信号，也会使得数据出错。个人愚见，欢迎原子兄和这里大师级的高手批改

正点原子 · 发表于 2013-11-22 23:22:50

回复【3楼】liuxuefei11:
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SPI不存在这个问题啊,通信过程可以被打断,spi是硬件的,你写了,就会去传输,不受你中断影响.

aaaaalaode · 发表于 2017-3-1 11:19:55

正点原子发表于 2013-11-22 23:22
回复【3楼】liuxuefei11:
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SPI不存在这个问题啊,通信过程可以被打断,spi ...

原子哥外部中断较多会影响spi的传输吗？这是你在某个帖子里说的
（我的读SD卡,都是最底层的时候,就关闭任务调度,防止OS打断.从而保证此次数据成功写入,其实这也不会损耗你太多时间. ）
我的也是中断较多，发现了spi的芯片不正常，但是不确定是数据量大对芯片造成的影响，还是中断对spi造成的影响。

又是一年冬 · 发表于 2023-12-14 13:39:47

正点原子发表于 2013-11-22 22:11
硬件SPI,没这个特殊要求.
硬件IIC就不知道了.

原子哥，我这有个程序困扰已久，三个定时器中断，1k优先级1,10k的优先级3级，40k的优先级2级，然后我iic以100k读没有问题，但是400k程序就死了，仿真显示在发送子地址后，就一直等待iic寄存器的某一位置1，然后就s了，我把三个中断注释掉，就又可以400k通信了，困扰已久，望原子哥给指点一下

又是一年冬 · 发表于 2023-12-15 09:19:56

liuxuefei11 发表于 2013-11-22 22:29
回复【2楼】正点原子:
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原子兄，我个人感觉SPI与I2C都可能出现这样问题 ...

大哥，我的硬件iic被定时器中断打断后，再返回iic然后程序就g了，显示ev5或者ev6或者就是总线忙没反应，您是咋解决这个问题的，软件iic会不会好点

unnormal · 发表于 2023-12-15 10:17:44

又是一年冬发表于 2023-12-15 09:19
大哥，我的硬件iic被定时器中断打断后，再返回iic然后程序就g了，显示ev5或者ev6或者就是总线忙没反应， ...

没有使用过STM32硬件IIC 都是软件模拟

如果功能结构设计允许的情况下  先关全局中断  操作完后再打开全局中断

如果中断设计时  不允许关中断  可以考虑SVC中断操作

其它方式  等待高手指点

又是一年冬 · 发表于 2023-12-15 13:47:34

unnormal 发表于 2023-12-15 10:17
没有使用过STM32硬件IIC 都是软件模拟

如果功能结构设计允许的情况下先关全局中断操作完后再打 ...

我需要频繁的读取iic采样的数据，没有办法关闭中断后再打开iic太频繁了，后来我尝试将iic函数放在定时器中断里（假设时间65ms）但是360k可以通信，400k就是不行；我把全局中断都给关闭了，但是400k不能通信，360k可以通信，360001包括360001往后就不能iic通信；我现在去试试把上拉阻值和接线电路改一下，再去试试。还有软件iic也去试试