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关于APB1=DIV2;APB2=DIV1;AHB=DIV1 DIV1和DIV2 是什么意思

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发表于 2013-5-7 21:26:58 | 显示全部楼层 |阅读模式

void Stm32_Clock_Init(u8 PLL)
{
 unsigned char temp=0;  
 MYRCC_DeInit();    //复位并配置向量表
 RCC->CR|=0x00010000;  //外部高速时钟使能HSEON
 while(!(RCC->CR>>17));//等待外部时钟就绪
RCC->CFGR=0X00000400; //APB1=DIV2;APB2=DIV1;AHB=DIV1;
 LL-=2;//抵消2个单位
 RCC->CFGR|=PLL<<18;   //设置PLL值 2~16
 RCC->CFGR|=1<<16;   //PLLSRC ON
 FLASH->ACR|=0x32;   //FLASH 2个延时周期

 RCC->CR|=0x01000000;  //PLLON
 while(!(RCC->CR>>25));//等待PLL锁定
 RCC->CFGR|=0x00000002;//PLL作为系统时钟 
 while(temp!=0x02)     //等待PLL作为系统时钟设置成功
 {  
  temp=RCC->CFGR>>2;
  temp&=0x03;
 }   
}  
RCC->CFGR=0X00000400; //APB1=DIV2;APB2=DIV1;AHB=DIV1;

DIV1,DIV2是什么意思   

 RCC->CFGR=0X00000400  RCC_CFGR 10:8 是对HCLK分频,HCLK和APB,AHB有关系么   HCLK不是AHB过后独立出来的时钟源么

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发表于 2013-5-7 21:33:54 | 显示全部楼层
DIV1是只不分频
DIV2是指2分频。
我是开源电子网www.openedv.com站长,有关站务问题请与我联系。
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 楼主| 发表于 2013-5-7 21:38:34 | 显示全部楼层
回复【2楼】正点原子:
---------------------------------
这里分频指的是对SYSCLK的分频? 
RCC->CFGR=0X00000400  RCC_CFGR 10:8 是对HCLK分频,HCLK和APB,AHB有关系么   HCLK不是AHB过后独立出来的时钟源么
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发表于 2013-5-7 21:43:10 | 显示全部楼层
看时钟树图去
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