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关于模拟SPI时序的不解？

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发表于 2017-3-4 18:06:46 | 显示全部楼层 |阅读模式

正点原子逻辑分析仪DL16热卖中，最多16通道，采样率最高可达1GHz，存储深度可达3.5Gbit

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对于SPI接口来说，CPOL控制闲时的电平，CPHA=0/1控制在CLK第一个/第二个跳变沿被采样。
但是模拟SPI的程序里为什么写数据是上升沿有效，读数据却是下降沿有效？

读写的边沿不应该是一致的么？

捕获.JPG

捕获.JPG

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看了这个帖子懂了http://bbs.elecfans.com/jishu_441914_1_1.html

正点原子逻辑分析仪DL16劲爆上市

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楼主| 发表于 2017-3-4 18:06:47 | 显示全部楼层

正点原子ESP32 AI开发套件上市，python

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