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发表于 2017-1-13 21:08:44 | 显示全部楼层 |阅读模式
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信息:运行Quartus素分析与综合
信息:版本15.1.0建185 10 / 21 / 2015 SJ标准版
信息:处理开始:1月13日2017 20:55:38
信息:命令:quartus_map -- read_settings_files = - write_settings_files =关闭led_line C led_line
信息(20030):并行编译已启用,将使用检测到的2个处理器的2
信息(12021):发现1个设计单位,包括1个实体,在源文件led_line。V
信息(12023):1:led_learn发现实体
错误(12007):顶层设计实体”led_line”是不确定的
错误:Quartus素分析和综合是不成功的。1错误,0警告
错误:虚拟内存:744 MB峰值
错误:处理结束:1月13日2017 20:56:01
错误:时间:00:00:23

正点原子逻辑分析仪DL16劲爆上市
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发表于 2017-1-20 13:33:45 | 显示全部楼层
貌似你led_line没加到工程里面。你再找找。
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 楼主| 发表于 2017-1-23 18:55:59 | 显示全部楼层
wye1102 发表于 2017-1-20 13:33
貌似你led_line没加到工程里面。你再找找。

应该加到工程了
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 楼主| 发表于 2017-1-25 09:49:42 | 显示全部楼层
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发表于 2017-1-25 20:58:37 | 显示全部楼层

麻烦分享下解决办法,谢谢
我是开源电子网www.openedv.com站长,有关站务问题请与我联系。
正点原子STM32开发板购买店铺http://openedv.taobao.com
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发表于 2017-1-25 20:58:48 | 显示全部楼层

麻烦分享下解决办法,谢谢
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 楼主| 发表于 2017-2-11 00:27:39 | 显示全部楼层
正点原子 发表于 2017-1-25 20:58
麻烦分享下解决办法,谢谢

这个是设计模块名和工程名文件名要一样的
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