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3GG来用AD5623

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发表于 2016-9-24 17:03:47 | 显示全部楼层 |阅读模式
对于AD5623这款电压输出芯片1)首先我们来看一下DataSheet
-AD5623-3/AD5623-5分别有3V和5V供电2款

-AD5623是12位精度的

-用户可选外部或内部基准电压源 ,默认使用外部基准电压源
-1.25 V/2.5 V、5 ppm/°C片内基准电压源
QQ图片20160924163734.png
可以发现输入
-SCLK:地球人都知道是时钟信号
-SYNC:?
-DIN:?
-LDAC:?
-CLR:地球人都知道是清除脚
-VDD:地球人都知道是电源
-GND:地球人都知道是地
-VREF:一看就知道这是上面说的基准电压源,不过他可用内部的嘛!
2)猜不到的咱去看看手册哈
QQ图片20160924164129.png
-SYNC:原来是控制端口
-DIN:原来是数据口
-LDAC:原来是更新DAC寄存器的,低有效,咱不用来做特殊功能,那就直接接地哈!

-有限制的要注意一下的:闹这边,Serial Clock Input. Data is clocked into the input shift register on the falling edge of the serial clock input. Data can be transferred at rates up to 50 MHz.(哇塞最快50Mhz,和GPIO的输出速度一样哎,就是是为什么我要用GPIO来模拟的原因啦)
看一眼输出,两路输出,哈哈,功能是很厉害的!
-VOUTA
-VOUTB
3)引脚都知道了,那应该看看怎么操作了
QQ图片20160924164858.png
(PS:干这行的这个逻辑图一定都懂,不解释了,简单的哈)
4)都差不都了,关注一下细节(都应该知道实际电路都不是理想的,那么延时何在!)
-看图
QQ图片20160924165117.png
看一眼发现,
t1:20ns,SCLK cycle time--1/50Mhz(懂吧)
t8:15ns,Minimum SYNC high time--最小时间,这个容易
t12:15ns,SCLK falling edge to LDAC rising edge-电平转换的时间
t15:300ns,CLR pulse activation time-和复位类似
其他的都13ns一下,OK(PS:都理解这里时间的意思吧,1/72Mhz=13.89ns)
好了看了那么多基本能用了,不过3GG比较喜欢人家的实际测试信号
那咱在看一眼-----------.....----------...-----哗哗哗看了好多测试图
QQ图片20160924170034.png
不亏待你们让你们也看一张形象的。
好啦正接的时间到了
----------------------------------------------------------------------------往下看
//ê1óÃGPIOÄ£ÄaAD56231¤×÷
////òy½Å3õê¼»ˉ
//void Dac_Out_Init(void)
//{
//        u8 i;
//        u16 data1[24];
//        u16 data2[24];
//        u16 data3[24];
//        RCC->APB2ENR|=1<<2;     //ê1&#196;üPORTAê±&#214;ó                                        
//        GPIOA->CRL&=0XFF00FFF0;        
//        GPIOA->CRL|=0X00330003;
//        GPIOA->ODR|=1<<5;       //PA5=1
//        GPIOA->ODR|=1<<4;       //PA4=1
//        //èí&#188;t&#184;′&#206;&#187;
//        for(i=0;i<24;i++)
//        data1=(SWReset>>i)&0x1;
//        Dac_Out_Manage(data1);
//        delay_us(4);
//        //&#213;y3£1¤×÷
//        for(i=0;i<24;i++)
//        data2=(Normal>>i)&0x1;
//        Dac_Out_Manage(data2);
//        delay_us(4);
//        //&#191;a&#198;&#244;&#196;ú2&#191;&#187;ù×&#188;μ&#231;&#209;1&#212;′
//        for(i=0;i<24;i++)
//        data3=(PowerRefOn>>i)&0x1;
//        Dac_Out_Manage(data3);
//        delay_us(4);
//}
////&#191;é±&#228;μ&#231;&#209;1ê&#228;3&#246;
////ê&#228;3&#246;·&#182;&#206;§£o0-2.5V~~0-10V
//void Dac_Out_Manage(u16 *din)
//{
//        u8 i;
//        GPIOA->ODR&=~(1<<5);    //PA5=0
//        i=i;
//        GPIOA->ODR&=~(1<<4);    //PA4=0£&#172;ê1&#196;üò&#198;&#206;&#187;&#188;&#196;′&#230;&#198;÷
//        i=i;
//        for(i=23;i<24;i--)
//        {
//                i=i;
//                GPIOA->ODR|=1<<5;     //PA5=1£&#172;&#184;&#223;μ&#231;&#198;&#189;
//                i=i;
//                PAout(0)=din;
//                i=i;
//          GPIOA->ODR&=~(1<<5);  //PA5=0£&#172;&#207;&#194;&#189;μ&#209;&#216;
//        }
//        i=i;
//        GPIOA->ODR|=1<<4;       //PA4=1£&#172;&#199;&#229;3yò&#198;&#206;&#187;&#188;&#196;′&#230;&#198;÷
//}
////′&#174;DDêy&#190;Y′|àí
////&#195;üá&#238;&#182;¨ò&#229;CmdDef:0~7
////μ&#216;&#214;·&#195;üá&#238;AddCmd:0,1,7
////12&#206;&#187;êy&#190;Ydata:0~4095
////ê1ó&#195;£oD′è&#235;2¢&#184;üD&#194;DACí¨μàA
//u32 Dac_Data_Mag(u8 CmdDef,u8 AddCmd,u16 data)
//{
//        u32 db23=0;
//        db23|=CmdDef<<19;
//        db23|=AddCmd<<16;
//        db23|=data<<4;
//        //xx+CmdDef+AddCmd+data+xxxx
//        return db23;                                                               
//}

-------------------------------------------------------------------------------------
我要先跑路了,看人家结婚去了,这个注释= =呜呜!!
不过大家看得懂的!!我相信!!学电路嘛该认真的就认真,有些东西嘛要粗心
这是特殊注释保密技术= = !
-----------------
谢谢!
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发表于 2016-9-24 18:55:09 | 显示全部楼层

不错不错,
写得很有趣。


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