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[国产FPGA] FPGL22添加debug core报错

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发表于 2023-5-12 22:46:02 | 显示全部楼层 |阅读模式

正点原子逻辑分析仪DL16热卖中，最多16通道，采样率最高可达1GHz，存储深度可达3.5Gbit

1金钱

开发板试验ip_fifo例程添加debug core报错

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你的fic抓取的位宽与你实际运用的位宽要对等，比如说你输入位宽18位，你的fifo设的是16位，如果你的fic抓取的是18位就会报错

正点原子逻辑分析仪DL16劲爆上市

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发表于 2023-5-12 22:46:03 | 显示全部楼层

正点原子ESP32 AI开发套件上市，python

你的fic抓取的位宽与你实际运用的位宽要对等，比如说你输入位宽18位，你的fifo设的是16位，如果你的fic抓取的是18位就会报错

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发表于 2023-5-15 09:11:28 | 显示全部楼层

报什么错，截图看看

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楼主| 发表于 2023-5-15 17:09:36 | 显示全部楼层

报没有连接时钟

配置了clock和trig

报没有连接

报没有连接

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