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[XILINX] HLS生成AXI-stream接口的IP核

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发表于 2021-3-10 10:42:27 | 显示全部楼层 |阅读模式
我参考的例程是https://blog.csdn.net/sements/article/details/95658792
用以下代码生成IP核,目的是从A端口输入数据,从B端口输出数据,A端口和B端口都设置成AXI-stream接口,工作方式和用FIFO的DMA回环测试类似。
#include "ap_axi_sdata.h"
void exchangeMac(ap_axis<32,1,1,1> A[50], ap_axis<32,1,1,1> B[50])
{
#pragma HLS INTERFACE s_axilite port=return
  int i;

  add_loop:
  for(i = 0; i < 50; i++){
    B.data = A.data.to_int() + 5;
    B.keep = A.keep;
    B.strb = A.strb;
    B.user = A.user;
    B.last = A.last;
    B.id = A.id;
    B.dest = A.dest;
  }
}

但是我发现SDK程序运行的时候,会一直在
  while ((XAxiDma_Busy(&AxiDma,XAXIDMA_DEVICE_TO_DMA)) ||                        (XAxiDma_Busy(&AxiDma,XAXIDMA_DMA_TO_DEVICE))) {
                                /* Wait */ }
波形显示没有数据传输,请问这是啥问题?
QQ图片20210310103828.png
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