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宏定义管脚电平问题，#define LCD_CS_SET GPIOC->BSRR=1<<9

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发表于 2011-12-17 15:06:42 | 显示全部楼层 |阅读模式

正点原子逻辑分析仪DL16热卖中，最多16通道，采样率最高可达1GHz，存储深度可达3.5Gbit

#define LCD_CS_SET GPIOC->BSRR=1<<9 //片选端口 PC9

这样子拉高PC9的话不是其他PC口全部都变成了低电平
原子为什么不这样子定义呢？
#define LCD_CS_SET GPIOC->BSRR|=1<<9 //片选端口 PC9
也不知道为什么#define LCD_CS_SET GPIOC->BSRR=1<<9 //片选端口 PC9
这样子操作也是正常的难道这样子不影响其他PC管脚吗？

正点原子逻辑分析仪DL16劲爆上市

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发表于 2013-7-20 10:49:56 | 显示全部楼层

正点原子ESP32 AI开发套件上市，python

回复【4楼】云中的太阳:
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这是快速设置IO,你也可以用ODR的.看你自己对速度的要求了.
另外这里不是拉高,而是推挽输出高/低

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发表于 2011-12-17 17:55:39 | 显示全部楼层

因为这个寄存器是置1有效的。

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楼主| 发表于 2011-12-17 21:59:46 | 显示全部楼层

回复【2楼】正点原子:
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原来这样子，看来得真正的去了解STM32才行。谢谢原子

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云中的太阳

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发表于 2013-7-20 10:48:56 | 显示全部楼层

回复【2楼】正点原子:

因为这个寄存器是置1有效的。

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原子哥，这个拉高拉低为什么不用ODR 而用BSRR？？

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