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PCB中的最小间隔规则为什么还会约束到丝印层符号之间以及丝印层符号和焊盘之间的间隔

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发表于 2013-11-3 20:28:23 | 显示全部楼层 |阅读模式
正点原子逻辑分析仪DL16热卖中，最多16通道，采样率最高可达1GHz，存储深度可达3.5Gbit
丝印层符号又不带电气特性，而且丝印层和焊盘完全在两个层怎么会有约束呢（主要是说我画的封装图形和焊盘离得太近，小于最小间隔）？？？还有就是我的规则设置中过孔最大孔径设置的是300mil，可是DRC检查的时候过孔只要大于100mil就报错，说过孔最小最大分别为1mil和100mil，跟我设置的完全没关系，可是其他规则我设置的都有效啊。求来人
正点原子逻辑分析仪DL16劲爆上市
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 楼主| 发表于 2013-11-3 20:29:39 | 显示全部楼层
正点原子ESP32 AI开发套件上市，python
@正点原子
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发表于 2013-11-3 22:04:29 | 显示全部楼层
规则改了DRC校验还是不对么？改错了吧
博观而约取,厚积而薄发。
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正点原子

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发表于 2013-11-3 22:23:03 | 显示全部楼层
看下我的设置：


我是开源电子网www.openedv.com站长，有关站务问题请与我联系。
正点原子STM32开发板购买店铺：http://openedv.taobao.com
正点原子官方微信公众平台，点击这里关注“正点原子”
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 楼主| 发表于 2013-11-4 10:30:08 | 显示全部楼层
回复【4楼】正点原子:
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这几个是不是不用检查，对板子正常工作没有影响
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 楼主| 发表于 2013-11-4 10:36:12 | 显示全部楼层


正点原子DS100手持Mini示波器发布，50M带宽，250M采样，双通道设计，美观大方，每个工程师都能用到.
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 楼主| 发表于 2013-11-4 10:38:03 | 显示全部楼层


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 楼主| 发表于 2013-11-4 10:38:30 | 显示全部楼层
回复【3楼】745021926:
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你帮我看看我的对不对
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发表于 2013-11-4 11:31:01 | 显示全部楼层
回复【8楼】骑着蜗牛追梦想:
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这个是不是RoutingVias真看不出来...看DRC的message报的什么错~
博观而约取,厚积而薄发。
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发表于 2013-11-4 11:31:22 | 显示全部楼层
回复【8楼】骑着蜗牛追梦想:
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然后对应着改就行了
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 楼主| 发表于 2013-11-4 11:39:35 | 显示全部楼层


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 楼主| 发表于 2013-11-4 11:40:42 | 显示全部楼层
回复【10楼】745021926:
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报错是Hole Size ,可是规则里没有Hole Size啊
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 楼主| 发表于 2013-11-4 11:44:21 | 显示全部楼层
回复【10楼】745021926:
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我错了，我找到了，可是Hole Size 和Roulting Val有什么区别吗
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发表于 2013-11-4 12:03:57 | 显示全部楼层
Routing Via Style这个是设置过孔大小的，只针对于过孔，Hole Size针对所有通孔，包括焊盘等等
博观而约取,厚积而薄发。
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 楼主| 发表于 2013-11-4 12:59:38 | 显示全部楼层
回复【14楼】745021926:
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谢谢
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发表于 2016-7-28 11:45:28 | 显示全部楼层
请问Hole Size的规则在哪里设置呢？大于100mil就会报错，这个应该可以设置吧？
不断追求，不断进步。
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