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发表于 2013-8-18 12:11:11 | 显示全部楼层 |阅读模式
1:开发指南寄存器版本第228页(第十八章  TFTLCD显示实验),有这么一段话:
但是由于CS切换延时的存在,我们这里可以设置ADDSET为较小的值,本章我们设置ADDSET为1,即2个HCLK周期
这个"
由于CS切换延时的存在"怎么理解,有哪些可供参考的资料?

2:标准例程-寄存器版本\实验11 TFTLCD显示实验,这个函数:
//读LCD数据
//返回值:读到的值
u16 LCD_RD_DATA(void)
{       
return LCD->LCD_RAM;  
}
编译器编译之后大致如下:
LDRH r0,[0x6c00 0800]    //r0即是读取到的数据
问题是,这条指令只占2个时钟周期,而一次完整的ModeA读操作包括(ADDSET+1+DATAST+1+2)=20个时钟周期,
为什么程序这样子写依然可以读到正确的数据?

3:为什么我用JTAG硬件仿真的时候,寄存器r0~r15都有变化,但states和sec却一直是同一个值,不会发生变化?


谢谢各位













真正牛逼的,不是那些可以随口拿来夸耀的事迹,而是那些在困境中依然保持微笑的凡人。 --程浩
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发表于 2013-8-18 15:04:55 | 显示全部楼层
1,这是根据实际波形总结出来的,就是即使你设置ADDSET为最小值,实际上RD的高电平还是很长...至于为什么,我也不知道,你可以通过示波器看一下。
2,这里的时间主要花在从地址:0x6c00 0800取数据,而不是将数据存入R0这条语句上。这样的语句应该是要先等待数据取得,然后再将数据传送到r0,两个部分。
3,这个得用jtag trace功能,时间才有变化,至于states,我倒没注意过,你可以试试trace下,这个值变化不。
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 楼主| 发表于 2013-8-18 23:35:46 | 显示全部楼层
回复【2楼】 正点原子 :
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嗯,实践才能出真知,不能太理论...
根据你的提示我开启了trace功能,硬件仿真后得出(详见附图):
LDR      r0,[0x0800 1362]  //5个时钟周期.执行后r0=0x6c0007fe
ADDS   r0,r0,#2                 //1个时钟周期.执行后r0=0x6c000800
LDRH   r0,[r0,#0x00]         //27个时钟周期>(ADDSET+1+DATAST+1+2)=20个时钟周期

我认为上述时间是比较可信的,因为程序里有个5us的延时,硬件仿真实测5.75us.

而如果用软件仿真,则第一条指令和第三条指令都是2个时钟周期,因此我就搞混了.多谢原子哥指点!


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发表于 2013-8-18 23:41:54 | 显示全部楼层
回复【3楼】brief7953:
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多谢你的实践总结。
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 楼主| 发表于 2013-8-18 23:50:16 | 显示全部楼层
回复【4楼】正点原子:
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原子哥客气,其实应该我们感谢你才对.你把我们中的很多人带进STM32的大门,又事无巨细不遗余力地为新人解答问题,这份品质难得啊
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