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PB3 PB4拉低

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发表于 2013-7-20 21:20:11 | 显示全部楼层 |阅读模式
原子哥,PB3,PB4端口分别连接着JTDO和JTRST连着10k电阻接3.3v,把电平直接拉高了。通过给PB端口送值,想将它拉低了可以不的??我设置了下可以让PB3,PB4端口输出低电平,但为什么不能使它输入也变低电平???
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发表于 2013-7-21 01:15:48 | 显示全部楼层
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 楼主| 发表于 2013-7-21 11:41:59 | 显示全部楼层
RCC->APB2ENR|=1<<2;    //使能PORTA时钟      
RCC->APB2ENR|=1<<5;    //使能PORTD时钟
RCC->APB2ENR|=1<<3;    //使能PORTB时钟
JTAG_Set(JTAG_SWD_DISABLE);
     
GPIOA->CRH&=0XFFFFFFF0; 
GPIOA->CRH|=0X00000003;//PA8 推挽输出     
        GPIOA->ODR|=1<<8;      //PA8 输出高
  
GPIOD->CRL&=0XFFFFF0FF;
GPIOD->CRL|=0X00000300;//PD.2推挽输出
GPIOD->ODR|=1<<2;      //PD.2输出高 

GPIOB->CRL&=0XFFF00FFF;
GPIOB->CRL|=0X00088000;//
GPIOB->ODR=0X0000;      //

这样子不能将PB3,PB4下拉么??我用万用表测得PB3,PB4还是高电平??为什么??设置成输出时,可以下拉的。。
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发表于 2013-7-21 14:26:56 | 显示全部楼层
回复【3楼】扶摇:
---------------------------------
外部的上拉强于内部的下拉,导致效果好是上拉...
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 楼主| 发表于 2013-7-21 14:33:16 | 显示全部楼层
那下拉可怎么办???还有一个问题 delay怎么越来越不准了,用久了就没以前准了,是不是可以哪里可以调整,把它变准回来 ??
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发表于 2013-7-21 14:35:35 | 显示全部楼层
回复【5楼】扶摇:
---------------------------------
换IO,或者把外部的两个上拉电阻去掉.
不可能不准了吧...
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 楼主| 发表于 2013-7-21 16:31:45 | 显示全部楼层
原子哥,你的淘宝店里怎么没有stm32的最小系统板啊 ??有卖么?最小系统板有自带AD或DA的么???
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发表于 2013-7-21 20:15:12 | 显示全部楼层
mini板差不多就是最小系统板了,自带AD,但是没有DA哦...
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 楼主| 发表于 2013-7-22 19:16:17 | 显示全部楼层
我们参加比赛不能用开发板的,想再买块最小板。。
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