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DXP2004怎样使多个原理图的运放集成在一个封装上

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发表于 2013-1-23 19:41:43 | 显示全部楼层 |阅读模式
正点原子逻辑分析仪DL16劲爆上市
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发表于 2013-1-24 00:04:54 | 显示全部楼层
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 楼主| 发表于 2013-1-24 15:58:11 | 显示全部楼层
回复【2楼】正点原子:
---------------------------------
就是说一个运放不是一个三角型的东西么在原理图上,我用的是四个运放集成在一起的运放芯片,但是画原理图的时候 ,分别往四个三角型填一样的封装,DXP2004调用了,四个封装,我想问怎么设置软件,使四个原封,就调用一个封装
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发表于 2013-1-24 21:04:54 | 显示全部楼层
这个没搞过,我的都是直接按照IC的外形画 的.
我是开源电子网www.openedv.com站长,有关站务问题请与我联系。
正点原子STM32开发板购买店铺http://openedv.taobao.com
正点原子官方微信公众平台,点击这里关注“正点原子”
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发表于 2013-2-1 09:36:07 | 显示全部楼层
你把标号修改成一个,如U3,然后在comment下边修改part1/4或2/4.应该就可以~!祝你OK!
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发表于 2013-3-21 14:14:37 | 显示全部楼层
回复【楼主位】神祗:
求组
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1.需要绘制成层次原理图,几张原理图属于一个项目。
2.运放是多运放吧,元件符号制作时分成不同的部分(part)来绘制,(与一般元件符号的区别是,这样绘制在自动标注的时采用的序号是U1A、U1B等,等于是U1的两个部分,而一般独立元件符号序号是U1。)可参考默认杂项库中的排阻(Res ack1、Res ack2、Res ack3、Res ack4)。
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发表于 2013-3-23 19:11:16 | 显示全部楼层
cadence 很容易做到的哦,不管是对称和不对称的IC,有空学学cadence,你就会发现比ad9 和pads好的多,现在各种高密度 复杂电路板都是cadence画的哦,希望对你有用。
http://mcu-web.taobao.com 有zigbee 无线电压、温湿度、继电器实验 zigbee自组网实验 stm32开发板 enc28j60以太网 web服务器
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