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[XILINX] 正点原子历程中DDR程序的问题

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发表于 2024-10-10 10:33:48 | 显示全部楼层 |阅读模式

正点原子逻辑分析仪DL16热卖中，最多16通道，采样率最高可达1GHz，存储深度可达3.5Gbit

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本帖最后由 CJC529 于 2024-10-11 14:12 编辑

程序里面是用移位寄存器计数器来写入FIFO 写入MIG的，如果MIG位宽大 512或者是256的话写入位宽是16或者是32 就得进行移位，读出数据也是读出256然后分别寄存在寄存器中，这样会不会出现时序问题？？？或者是高频时钟下，不稳定的程序

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正点原子逻辑分析仪DL16劲爆上市

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发表于 2024-10-10 10:33:49 | 显示全部楼层

正点原子ESP32 AI开发套件上市，python

CJC529 发表于 2024-10-10 21:56
就是这种写法问题，比如读出一个256位宽的数据存到二维数组里面，然后计数器读取，这存储的稳定吗

稳定的

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发表于 2024-10-10 17:05:45 | 显示全部楼层

为啥会有时序问题，主要是不要跨时钟域去采数据

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楼主| 发表于 2024-10-10 21:56:27 | 显示全部楼层

QinQZ 发表于 2024-10-10 17:05
为啥会有时序问题，主要是不要跨时钟域去采数据

就是这种写法问题，比如读出一个256位宽的数据存到二维数组里面，然后计数器读取，这存储的稳定吗

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