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[XILINX] Vivado与modelsim仿真卡在Executing analysis and compilation step

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发表于 2023-12-14 23:57:35 | 显示全部楼层 |阅读模式
参考这个帖子:
https://blog.csdn.net/sinat_31206523/article/details/103866723/

实际解决方法:
1、使用modelsim进行编译,找到语法错误。
2、modelsim编译通过后,使用vivavo进行联合仿真,遇到网络名不显示的问题。
3、取消联合仿真,使用vivado进行仿真,发现潜在错误:对wire网络重复赋值(2行一样的wire语句)
4、修改后仿真通过。

总结:
1、vivado不能找到modelsim里的语法错误。
2、modelsim编译无法找到潜在错误,需要使用vivado执行一次仿真后才能找到错误。
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