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[XILINX] 关于 嵌入式sdk开发部分QSPI烧录失败的问题

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发表于 2023-3-21 20:28:23 | 显示全部楼层 |阅读模式
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本帖最后由 Sue43 于 2023-3-21 20:30 编辑


cmd /C program_flash -f \
C:\Users\Sue\Desktop\Project\ZYNQ\axi_gpio\axi_gpio.sdk\FSBL\bootimage\BOOT.bin -offset 0 \
-flash_type qspi-x4-single -fsbl \
C:\Users\Sue\Desktop\Project\ZYNQ\axi_gpio\axi_gpio.sdk\FSBL\Debug\FSBL.elf -cable type \
xilinx_tcf url TCP:127.0.0.1:3121

****** Xilinx Program Flash
****** Program Flash v2018.3 (64-bit)
  **** SW Build 2405991 on Thu Dec  6 23:38:27 MST 2018
    ** Copyright 1986-2018 Xilinx, Inc. All Rights Reserved.


WARNING: Failed to connect to hw_server at TCP:127.0.0.1:3121
Attempting to launch hw_server at TCP:127.0.0.1:3121

Connected to hw_server @ TCP:127.0.0.1:3121
Available targets and devices:
Target 0 : jsn-JTAG-HS1-210512180081

ERROR: Given target do not exist

cmd /C program_flash -f \
C:\Users\Sue\Desktop\Project\ZYNQ\axi_gpio\axi_gpio.sdk\FSBL\bootimage\BOOT.bin -offset 0 \
-flash_type qspi-x4-single -fsbl \
C:\Users\Sue\Desktop\Project\ZYNQ\axi_gpio\axi_gpio.sdk\FSBL\Debug\FSBL.elf -cable type \
xilinx_tcf url TCP:127.0.0.1:3121

****** Xilinx Program Flash
****** Program Flash v2018.3 (64-bit)
  **** SW Build 2405991 on Thu Dec  6 23:38:27 MST 2018
    ** Copyright 1986-2018 Xilinx, Inc. All Rights Reserved.


WARNING: Failed to connect to hw_server at TCP:127.0.0.1:3121
Attempting to launch hw_server at TCP:127.0.0.1:3121

Connected to hw_server @ TCP:127.0.0.1:3121
Available targets and devices:
Target 0 : jsn-JTAG-HS1-210512180081
        Device 0: jsn-JTAG-HS1-210512180081-4ba00477-0

Retrieving Flash info...

Initialization done, programming the memory
===== mrd->addr=0xF800025C, data=0x00000000 =====
BOOT_MODE REG = 0x00000000
Downloading FSBL...
Running FSBL...
Finished running FSBL.
===== mrd->addr=0xF8000110, data=0x0015E2C0 =====
READ: ARM_PLL_CFG (0xF8000110) = 0x0015E2C0
===== mrd->addr=0xF8000100, data=0x0001B008 =====
READ: ARM_PLL_CTRL (0xF8000100) = 0x0001B008
===== mrd->addr=0xF8000120, data=0x1F000200 =====
READ: ARM_CLK_CTRL (0xF8000120) = 0x1F000200
===== mrd->addr=0xF8000118, data=0x00113220 =====
READ: IO_PLL_CFG (0xF8000118) = 0x00113220
===== mrd->addr=0xF8000108, data=0x00024008 =====
READ: IO_PLL_CTRL (0xF8000108) = 0x00024008
Info:  Remapping 256KB of on-chip-memory RAM memory to 0xFFFC0000.
===== mrd->addr=0xF8000008, data=0x00000000 =====
===== mwr->addr=0xF8000008, data=0x0000DF0D =====
MASKWRITE: addr=0xF8000008, mask=0x0000FFFF, newData=0x0000DF0D
===== mwr->addr=0xF8000910, data=0x000001FF =====
===== mrd->addr=0xF8000004, data=0x00000000 =====
===== mwr->addr=0xF8000004, data=0x0000767B =====
MASKWRITE: addr=0xF8000004, mask=0x0000FFFF, newData=0x0000767B




U-Boot 2018.01-00073-g63efa8c-dirty (Oct 04 2018 - 08:22:22 -0600)



Model: Zynq CSE QSPI Board

Board: Xilinx Zynq

Silicon: v3.1

DRAM:  256 KiB

WARNING: Caches not enabled

Using default environment



In:    dcc

Out:   dcc

Err:   dcc

Zynq> sf probe 0 0 0


SF: unrecognized JEDEC id bytes: 00, 00, 00

Failed to initialize SPI flash at 0:0 (error -2)

Zynq> ERROR: [Xicom 50-186] Error while detecting SPI flash device - unrecognized JEDEC id bytes: 00, 00, 00

Problem in running uboot
Flash programming initialization failed.

ERROR: Flash Operation Failed


已启用JTAG模式,请问问题出在哪


最佳答案

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发表于 2023-3-21 20:28:24 | 显示全部楼层
Sue43 发表于 2023-3-22 18:50
你好,不是用的例程,但是是跟这文档操作的,我也不知道问题出在哪,刚试了试历程是可以的

用例程的Vivado工程,你自己创建软件工程,看下是Vivado硬件搭建问题,还是软件问题
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发表于 2023-3-22 09:38:24 | 显示全部楼层
直接用例程烧录的吗
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 楼主| 发表于 2023-3-22 18:50:05 | 显示全部楼层
QinQZ 发表于 2023-3-22 09:38
直接用例程烧录的吗

你好,不是用的例程,但是是跟这文档操作的,我也不知道问题出在哪,刚试了试历程是可以的
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