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[XILINX] 硬件实现颜色插值时shift ram IP核深度不足

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发表于 2022-11-7 18:20:22 | 显示全部楼层 |阅读模式
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cmos采集数据为2592*1944的bayer格式,使用硬件fpga来实现bayer2rgb时,使用shift ram IP核时深度该如何设置?这里的深度最大1088,远不足2592,该如何实现使用shift ram存储图像的一行数据呢?

QQ截图20221107181904.png
正点原子逻辑分析仪DL16劲爆上市
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发表于 2022-11-9 09:12:03 | 显示全部楼层
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 楼主| 发表于 2022-11-9 16:42:32 | 显示全部楼层

感谢回复,我在使用BRAM做line buffer时bram该如何配置呢,使用真双端口ram还是伪双端口ram,如何实现bram写入当前行数据时同时读出上一行数据
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发表于 2022-11-10 08:57:59 | 显示全部楼层
可以做2个ram,一个写入当前行,一个写入上一行,你可以看下原子的中值滤波实验,那里面讲了怎么实现这个的
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