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[ALTERA] 开拓者板子怎么输出PWM,蜂鸣器实验没有使用PWM波驱动

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发表于 2021-4-4 22:15:02 | 显示全部楼层 |阅读模式
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FPGA,开拓者开发板子,看到有输出频率的例程,但是不知道怎么改变脉宽,请大家指点一下

最佳答案

查看完整内容[请看2#楼]

开拓者的蜂鸣器是有源的,只需要给高电平就能鸣叫; 想输出可变脉宽的PWM,可以下载领航者或者达芬奇开发板的例程,里面有呼吸灯的实验,可以参考下
正点原子逻辑分析仪DL16劲爆上市
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发表于 2021-4-4 22:15:03 | 显示全部楼层
开拓者的蜂鸣器是有源的,只需要给高电平就能鸣叫;
想输出可变脉宽的PWM,可以下载领航者或者达芬奇开发板的例程,里面有呼吸灯的实验,可以参考下
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 楼主| 发表于 2021-4-10 20:55:03 | 显示全部楼层
QinQZ 发表于 2021-4-4 22:15
开拓者的蜂鸣器是有源的,只需要给高电平就能鸣叫;
想输出可变脉宽的PWM,可以下载领航者或者达芬奇开发 ...

板子芯片不兼容啊!~我先看看吧
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发表于 2021-4-11 09:04:33 | 显示全部楼层
HerryZ 发表于 2021-4-10 20:55
板子芯片不兼容啊!~我先看看吧

Verilog代码是通用的,把代码拷贝过来
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 楼主| 发表于 2021-4-13 20:58:03 | 显示全部楼层
我在网上下载了一段代码,可以用,现在我贴上来
`timescale 1ns / 1ps
module pwm_gen(

input rst_n,
input sysclk,
input en,

input [15:0] period,
input [15:0] h_time,

output reg pwm

);

reg [31:0] cnt;
//period=16'h7800;

always @ (posedge sysclk or negedge rst_n)
begin
    if(!rst_n)
        cnt <= 0;
    else
                begin
                        if(cnt >= period - 1 )
                          cnt <= 0;
                        else
                          cnt <= cnt + 1;
                end
end

always @ (posedge sysclk or negedge rst_n)
begin
    if(!rst_n)
        pwm <= 0;
    else    //rst_n = 1
    begin
        if(en == 0)
            pwm <= 0;
        else    //en = 1
        begin
            if(cnt <= h_time - 1)
                pwm <= 1;
            else
                pwm <= 0;
        end
    end
end

endmodule
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