AD9覆铜出现奇怪的问题 - OpenEdv-开源电子网

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作者: it_do_just 时间: 2016-3-12 23:26

大雄先生发表于 2016-3-17 13:22
你把重要部分移除，再上传一下吧，我操作试试。

谢谢，我发现问题了，有个电阻是4K7但是我是默认隐藏电阻值的，这个4K7放在了Bottom layer，改回丝印层就好了

作者: FantaSy_ 时间: 2016-3-12 23:28
规则设置问题!!!

作者: it_do_just 时间: 2016-3-12 23:30

FantaSy_ 发表于 2016-3-12 23:28
规则设置问题!!!

具体是哪个规则，麻烦指点下

作者: FantaSy_ 时间: 2016-3-12 23:32
我电脑没装AD

作者: it_do_just 时间: 2016-3-12 23:33

FantaSy_ 发表于 2016-3-12 23:32
我电脑没装AD

晕...............

作者: FantaSy_ 时间: 2016-3-12 23:37
你百度下就知道了！！

作者: it_do_just 时间: 2016-3-13 11:10
百度目前查找不出

作者: it_do_just 时间: 2016-3-13 22:14
顶

作者: xuande 时间: 2016-3-13 23:19

想不出，挺奇怪

作者: telentmmc 时间: 2016-3-14 08:37
好奇怪的样子，感觉是在这个地方画了什么东西导致不能覆铜。。
方便的话上传工程文件也许容易分析一点

作者: it_do_just 时间: 2016-3-14 09:05

telentmmc 发表于 2016-3-14 08:37
好奇怪的样子，感觉是在这个地方画了什么东西导致不能覆铜。。
方便的话上传工程文件也许容易分析一点

公司的项目，不方便传，我看了各个层都没看什么问题，把这个封装移掉也还是存在一样的问题，整个PCB里面只有这个地方有这个问题，也试过根据网上改了一些规则也没什么作用

作者: 忘月19920216 时间: 2016-3-14 11:08
以前也碰到过，但是当场就解决了，所以没做记录，现在想不起来了

作者: xuande 时间: 2016-3-14 11:15

把那里的实物都删除，试试看。

作者: 燕川离影 时间: 2016-3-14 17:06
会不会是那个地方被你不小心画上polygon pour cutout了？双击一下那个区域试试，看看有没有，有的话删掉它，然后重新覆铜就好了。

作者: it_do_just 时间: 2016-3-14 20:34

燕川离影发表于 2016-3-14 17:06
会不会是那个地方被你不小心画上polygon pour cutout了？双击一下那个区域试试，看看有没有，有的话删掉它 ...

你的这个问题还是比较容易发现的，不是这个问题

作者: 大雄先生 时间: 2016-3-16 09:43
如果附近元件移走后还是不能铺铜，你先打开设置，显示所有层，之后切换层，看是不是有特殊层在限制。

作者: it_do_just 时间: 2016-3-16 20:00
本帖最后由 229382777@qq.com 于 2016-3-16 20:04 编辑

大雄先生发表于 2016-3-16 09:43
如果附近元件移走后还是不能铺铜，你先打开设置，显示所有层，之后切换层，看是不是有特殊层在限制。

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